### [游戏主机SoC封装技术：从FC-BGA到CoWoS，PS5、Switch 2与下一代Xbox的芯片为什么集体走向高端制程与先进封装](https://www.huociguo.com/article/1383)

**Published:** 2026-09-19T13:03:31

**Author:** 米了

**Excerpt:** 过去三十年，讨论一台游戏主机的性能，话题永远停留在"几纳米""多少TFLOPS""显存多大"。制程节点和浮点算…

过去三十年，讨论一台游戏主机的性能，话题永远停留在”几纳米””多少TFLOPS””显存多大”。制程节点和浮点算力被反复咀嚼，而把硅片变成一颗能焊上主板、能连续跑十年不虚焊的芯片的那道工序——封装——长期被当成幕后工种 📦

但这层”幕后”正在走到台前。当单芯片的面积逼近光刻极限、当3nm晶圆的价格让BOM表无法承受、当AI超分与路径追踪把内存带宽的需求推到新高，主机厂商发现：能继续拉出性能差距的地方，已经不只是制程，而是封装。从统治主机市场二十余年的FC-BGA，到AI芯片专属的CoWoS，一场关于”芯片怎么叠、怎么连、怎么散热”的技术迁移，正在次世代主机的设计图纸上悄然发生 ⚡

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## 一、FC-BGA：主机产业最稳的那块地基

FC-BGA（Flip Chip Ball Grid Array，倒装芯片球栅阵列）的逻辑并不复杂：把硅片翻转过来，用微小的凸点（bump）直接压在封装基板上，信号不再绕道金线，而是垂直下传；基板底部再植上锡球，连到主板。相比更早的引线键合，它的I/O密度更高、寄生电感更小、散热路径更短，芯片背面可以直接贴散热器——这三点恰好是游戏主机最需要的：高带宽的显存控制器、长时间满载的稳定性、以及在封闭机箱里可控的热设计 🔧

索尼PS5的定制SoC（代号Oberon，AMD Zen2 CPU + RDNA2 GPU）由台积电7nm制造，封装环节交给了日月光半导体与矽品精密完成；后续的Oberon Plus改用台积电6nm后，芯片面积从约300mm²收缩到约260mm²，散热方案也随之一并简化。任天堂Switch 2的NVIDIA定制T239（三星8nm）同样走精简路线——封装面积只有同源的Jetson AGX Orin处理器的约三分之一，才塞得进掌机主板。

这条路径的共同点是：**单片、有机基板、成本可控、产能充裕**。对一台要卖五六年的客厅设备来说，良率和单价远比极限性能重要。FC-BGA之所以能统治主机产业，不是因为它最强，而是因为它最稳 💰

## 二、三堵墙：单芯片方案正在撞上限

然而进入2020年代后半段，三条物理与经济上的墙同时逼近。

**第一堵是面积墙。**​ 光罩尺寸决定了单颗裸片的物理上限，芯片越大，单片晶圆的产出越少，一颗缺陷就可能报废整片。当RDNA5级别的GPU要塞进68个计算单元、同时还要容纳CPU、NPU、媒体引擎与显存控制器，单芯片方案的面积与良率都会变得难以接受。

**第二堵是成本墙。**​ 3nm、2nm晶圆的价格呈指数级上升，把所有模块都压在最先进节点上制造，是极其奢侈的做法。而CPU、I/O、模拟电路并不都需要最先进制程——把它们”一刀切”地推进3nm，等于为不需要的部分付费。

**第三堵是带宽墙。**​ 路径追踪与AI超分吃的是带宽而非纯算力。传统方案中，显存颗粒通过PCB走线连到SoC，距离长、功耗高；而AI芯片早已用另一种方式解决了这个问题。

## 三、CoWoS登场：0.5μm对10μm的代差

CoWoS（Chip on Wafer on Substrate）是台积电在2012年量产、如今被整合进3DFabric平台的2.5D封装技术，按中介层材料分为CoWoS-S（硅中介层）、CoWoS-R（RDL重布线层）与CoWoS-L（局部硅互连+RDL）三条分支。

它的核心思路是：在逻辑芯片与HBM之间插入一层中介层（Interposer），用硅通孔（TSV）垂直导通，让多颗芯粒以极高密度并排互连，再整体贴装到封装基板上。把内存从”PCB对岸”搬到”隔壁座位”，传输距离缩短一个数量级，带宽和能效随之跃升 🧩

差距有多直观？FC-BGA的基板布线线宽/线距大致在10μm/10μm量级，而CoWoS的中介层可以做到0.5μm/0.5μm。按台积电早年的公开口径，CoWoS相比FC-BGA可带来数倍的性能提升与约两成的能耗下降——这也是它成为AI加速器标配的根本原因。

## 四、主机芯片的”芯粒化”已经开始

真正有意思的信号，出现在次世代主机的方案里。

微软下一代Xbox（Project Helix）搭载的AMD定制APU代号Magnus，采用台积电N3P工艺，CPU为3个Zen 6核心加8个Zen 6c核心的混合设计，GPU为RDNA 5架构的68个计算单元，配48GB GDDR7显存（192-bit）与最高110 TOPS算力的专用NPU。更关键的是架构：这颗芯片放弃了一体化单片结构，改为**CPU与GPU分离的芯粒（chiplet）设计**，两者之间通过384-bit位宽的互连通道连接，芯片总面积超过400mm²。

一旦拆成芯粒，”封装”就不再是收尾工序，而是决定CPU和GPU能否像一颗芯片那样协同工作的核心技术。相比之下，PS6的APU（代号Orion）据传仍为台积电3nm单芯片、面积约280mm²、54个计算单元、160-bit GDDR7、TDP 160W——两条路线的分歧本身，就是”要不要为封装复杂性买单”的现实博弈。

## 五、主机不会简单复制AI芯片的封装路线

但要清醒地看到三条硬约束。

**产能约束。**​ CoWoS目前是稀缺资源：台积电占据全球八成以上CoWoS产能，2026年底月产能预计约12万至14万片，2027年有望提升至20万片左右，而英伟达一家就预订了2026年约80万至85万片晶圆的CoWoS产能，占其总产能半数以上。在AI订单排队的前提下，主机厂商很难拿到稳定且廉价的大宗CoWoS配额。

**成本约束。**​ 一台主机的售价区间是刚性的。CoWoS需要硅中介层、TSV、微凸块与更复杂的载板，成本远高于FC-BGA，而这部分成本最终要由终端售价消化——Project Helix的传闻定价区间已经上探到999至1200美元，这本身就是压力信号。

**形态约束。**​ HBM的高带宽伴随高功耗与高发热，对掌机和静音客厅设备并不友好。Switch 2底座模式整机功耗仅约22W、掌机模式10W出头，这类产品需要的不是HBM，而是LPDDR5X加上足够的缓存与压缩技术。

因此更现实的答案是：**主机走向的不是”CoWoS化”，而是”先进封装化”**——高端FC-BGA承载多芯粒、InFO类扇出方案用于紧凑型设备、局部SoIC或硅桥解决CPU与GPU之间的高带宽互连，再配合GDDR7、大容量缓存与通用压缩技术把带宽补齐。CoWoS是这条光谱上最贵、最强的一端，未必是终点，却一定是参照系 🎯

## 结尾

从FC-BGA到CoWoS，本质上讲的是同一件事：当制程微缩的红利越来越贵，性能的增量从哪里来。游戏主机曾经是”够用就好”的代名词，如今却在同一条赛道上与AI芯片争夺产能、争夺带宽、争夺散热余量。

次世代主机的分水岭，或许不会写在TFLOPS的宣传页上，而是藏在芯片底部那层看不见的互连里。谁能在成本、产能与性能之间找到最优的封装组合，谁就能在下一个五年里，把”客厅里的4K/120帧”从演示文稿变成玩家的日常 🎮

**Categories:** 游戏主机

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